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FA4
Ç×°øÀüÀÚ¥²
ÁÂÀå : ÀÌâ¿­(ÀÎÇÏ´ëÇб³) 09:00~10:20
FA4-1
09:00~09:20
[00103] ¿ìÁÖ È¯°æ¿¡¼­ÀÇ ÀüÀÚ ºÎǰ ¼ö¸í ¿¹ÃøÀ» À§ÇÑ ÅëÇÕ °íÀå·ü ºÐ¼®: ¹°¸®Àû °íÀå·ü°ú ¹æ»ç¼± °íÀå·ü
À̵¿¹Î, ³ªÁ¾È­(Çѱ¹Ç×°ø´ëÇб³)
FA4-2
09:20~09:40
[00021] FPGA¸¦ ÀÌ¿ëÇÑ ´Ùä³Î SDLC Åë½Å µ¥ÀÌÅÍ È¹µæ ¹× DMA Àü¼Û±â¼ú ¿¬±¸
¹è¼­ÁØ, ½Åµ¿¿í(ÄÚÃ÷Å×Å©³î·ÎÁö)
FA4-3
09:40~10:00
[00022] FPGA ±â¹Ý PCIe ½Ã½ºÅÛÀÇ Åë½ÅºÒ·®¿¡ °üÇÑ ¿¬±¸
À¯ÈñÁ¾, ±è¼ö·Î(ÄÚÃ÷Å×Å©³î·ÎÁö)
FA4-4
10:00~10:20
[00269] Ç︮ÄßÅÍ Ç×ÀüÀåºñ¿¡ »óÅ ±â¹Ý °ü¸®+(CBM+) »ç¿ëÀÇ ¿î¿µÀ¯Áöºñ¿ë ¿µÇâ
¹Ú°æ¹Î(Çѱ¹Ç×°ø´ëÇб³), Çü¼º°ü(·¹¿À³ª¸£µµ), À̵¿¹Î(Çѱ¹Ç×°ø´ëÇб³), ±ÇÁöÈÆ(Ç×°ø¾ÈÀü±â¼ú¿ø), ±èÁÖ¿µ(´ëÇÑÇ×°ø¿¬±¸¼Ò), ¼ÛÁ¤¹Î((ÁÖ)³×¸ð½Ã½º), ³ªÁ¾È­(Çѱ¹Ç×°ø´ëÇб³)

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¿ì) 34909, ´ëÀü±¤¿ª½Ã Áß±¸ °è¹é·Î 1719 (¿À·ùµ¿, ¼¾Æ®¸®¿ÀÇǽºÅÚ 1206È£)
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